圖書簡介
品牌：圖書詳情 商品基本信息，請以下列介紹為準 商品名稱： 數(shù)字電子技術 作者： 佘新平 市場價： 31.8元 文軒網(wǎng)價： 24.8元【78折】 ISBN號： 9787560939490 出版社： 華中科技大學出版社 商品類型： 圖書
其他參考信息（以實物為準） 裝幀： 開本：16開 語種： 出版時間：2008-03-01 版次：1 頁數(shù)： 印刷時間：2008-06-03 印次：1 字數(shù)： 溫馨提示：出版時間超過3年的圖書，因長時間儲存可能會產(chǎn)生紙張缺陷，敬請諒解！
內(nèi)容簡介 全書共11章，主要內(nèi)容有：數(shù)制與編碼、邏輯門、邏輯代數(shù)基礎、組合邏輯電路、時序邏輯電路、存儲器與可編程器件、D／A與A／D轉(zhuǎn)換器、脈沖波形的產(chǎn)生與整形電路等。
目錄 1 數(shù)制與編碼
1.1 數(shù)字電路基礎知識
1.2 數(shù)制
1.3 數(shù)制轉(zhuǎn)換
1.4 二進制編碼
本章小結(jié)
習題一
2 邏輯門
2.1 基本邏輯門
2.2 復合邏輯門
2.3 其他邏輯門
2.4 集成電路邏輯門
本章小結(jié)
習題二
3 邏輯代數(shù)基礎
3.1 概述
3.2 邏輯代數(shù)的運算規(guī)則
3.3 邏輯函數(shù)的代數(shù)化簡法
3.4 邏輯函數(shù)的標準形式
3.5 邏輯函數(shù)的卡諾圖化簡法
本章小結(jié)
習題三
4 組合邏輯電路
4.1 組合邏輯電路的分析
4.2 組合邏輯電路的設計
4.3 編碼器
4.4 譯碼器
4.5 數(shù)據(jù)選擇器與數(shù)據(jù)分配器
4.6 加法器
4.7 比較器
4.8 碼組轉(zhuǎn)換電路
4.9 組合邏輯電路的競爭與冒險
本章小結(jié)
習題四一
5 觸發(fā)器
5.1 RS觸發(fā)器
5.2 D觸發(fā)器
5.3 JK觸發(fā)器
5.4 不同類型觸發(fā)器的相互轉(zhuǎn)換
本章小結(jié)
習題五
6 寄存器與計數(shù)器
6.1 寄存器與移位寄存器
6.2 異步N進制計數(shù)器
6.3 同步N進制計數(shù)器
6.4 集成計數(shù)器
本章小結(jié)
習題六
7 時序邏輯電路的分析與設計
7.1 概述
7.2 時序邏輯電路的分析
7.3 同步時序邏輯電路的設計
本章小結(jié)
習題七
8 存儲器與可編程邏輯器件
8.1 存儲器概述
8.2 RAM
8.3 ROM
8.4 快閃存儲器
8.5 存儲器的擴展
8.6 可編程陣列邏輯
8.7 通用陣列邏輯
8.8 CPLD、FPGA和在系統(tǒng)編程技術簡介
本章小結(jié)
習題八
9 D／A轉(zhuǎn)換器和A／D轉(zhuǎn)換器
9.1 概述
9.2 D／A轉(zhuǎn)換器
9.3 A／D轉(zhuǎn)換器
本章小結(jié)
習題九
10 脈沖波形的產(chǎn)生與整形電路
10.1 概述
10.2 多諧振蕩器
10.3 單穩(wěn)態(tài)觸發(fā)器
10.4 施密特觸發(fā)器
10.5 555定時器及其應用
本章小結(jié)
習題十
11 數(shù)字集成電路簡介
11.1 TTL門電路
11.2 CMOS門電路
11.3 數(shù)字集成電路的使用
本章小結(jié)
習題十一
參考文獻
專業(yè)詞匯漢英對照
目錄
品牌：圖書
| 商品基本信息，請以下列介紹為準 | |
| 商品名稱： | 數(shù)字電子技術 |
| 作者： | 佘新平 |
| 市場價： | 31.8元 |
| 文軒網(wǎng)價： | 24.8元【78折】 |
| ISBN號： | 9787560939490 |
| 出版社： | 華中科技大學出版社 |
| 商品類型： | 圖書 |
| 其他參考信息（以實物為準） | ||
| 裝幀： | 開本：16開 | 語種： |
| 出版時間：2008-03-01 | 版次：1 | 頁數(shù)： |
| 印刷時間：2008-06-03 | 印次：1 | 字數(shù)： |
| 溫馨提示：出版時間超過3年的圖書，因長時間儲存可能會產(chǎn)生紙張缺陷，敬請諒解！ | ||
| 內(nèi)容簡介 | |
| 全書共11章，主要內(nèi)容有：數(shù)制與編碼、邏輯門、邏輯代數(shù)基礎、組合邏輯電路、時序邏輯電路、存儲器與可編程器件、D／A與A／D轉(zhuǎn)換器、脈沖波形的產(chǎn)生與整形電路等。 |
| 目錄 | |
| 1 數(shù)制與編碼 1.1 數(shù)字電路基礎知識 1.2 數(shù)制 1.3 數(shù)制轉(zhuǎn)換 1.4 二進制編碼 本章小結(jié) 習題一 2 邏輯門 2.1 基本邏輯門 2.2 復合邏輯門 2.3 其他邏輯門 2.4 集成電路邏輯門 本章小結(jié) 習題二 3 邏輯代數(shù)基礎 3.1 概述 3.2 邏輯代數(shù)的運算規(guī)則 3.3 邏輯函數(shù)的代數(shù)化簡法 3.4 邏輯函數(shù)的標準形式 3.5 邏輯函數(shù)的卡諾圖化簡法 本章小結(jié) 習題三 4 組合邏輯電路 4.1 組合邏輯電路的分析 4.2 組合邏輯電路的設計 4.3 編碼器 4.4 譯碼器 4.5 數(shù)據(jù)選擇器與數(shù)據(jù)分配器 4.6 加法器 4.7 比較器 4.8 碼組轉(zhuǎn)換電路 4.9 組合邏輯電路的競爭與冒險 本章小結(jié) 習題四一 5 觸發(fā)器 5.1 RS觸發(fā)器 5.2 D觸發(fā)器 5.3 JK觸發(fā)器 5.4 不同類型觸發(fā)器的相互轉(zhuǎn)換 本章小結(jié) 習題五 6 寄存器與計數(shù)器 6.1 寄存器與移位寄存器 6.2 異步N進制計數(shù)器 6.3 同步N進制計數(shù)器 6.4 集成計數(shù)器 本章小結(jié) 習題六 7 時序邏輯電路的分析與設計 7.1 概述 7.2 時序邏輯電路的分析 7.3 同步時序邏輯電路的設計 本章小結(jié) 習題七 8 存儲器與可編程邏輯器件 8.1 存儲器概述 8.2 RAM 8.3 ROM 8.4 快閃存儲器 8.5 存儲器的擴展 8.6 可編程陣列邏輯 8.7 通用陣列邏輯 8.8 CPLD、FPGA和在系統(tǒng)編程技術簡介 本章小結(jié) 習題八 9 D／A轉(zhuǎn)換器和A／D轉(zhuǎn)換器 9.1 概述 9.2 D／A轉(zhuǎn)換器 9.3 A／D轉(zhuǎn)換器 本章小結(jié) 習題九 10 脈沖波形的產(chǎn)生與整形電路 10.1 概述 10.2 多諧振蕩器 10.3 單穩(wěn)態(tài)觸發(fā)器 10.4 施密特觸發(fā)器 10.5 555定時器及其應用 本章小結(jié) 習題十 11 數(shù)字集成電路簡介 11.1 TTL門電路 11.2 CMOS門電路 11.3 數(shù)字集成電路的使用 本章小結(jié) 習題十一 參考文獻 專業(yè)詞匯漢英對照 |
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