北京工業(yè)大學信息學部電子科學與技術研究生導師介紹：劉素娟

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一、基本情況

劉素娟，女，1978年10月生，博士，副教授，碩士生導師，北京工業(yè)大學日新人才。

·2006年6月，畢業(yè)于北京工業(yè)大學電子信息與控制工程學院，獲博士學位。
·2006年7月至今在北京工業(yè)大學電子信息與控制工程學院工作。
·2010年受國家外專局和國家集成電路人才培養(yǎng)基地資助，赴比利時魯汶大學K.U.Leuven做訪問學者，期間在歐洲微電子研發(fā)中心IMEC進修數(shù)�；旌霞�成電路設計及SoC設計。
·2014年赴愛爾蘭都柏林大學（UCD）交流訪問。

二、研究方向：集成電路設計，包括模擬集成電路設計、數(shù)字集成電路設計、數(shù)�；旌霞�成電路設計以及數(shù)字信號處理等。

三、主持的科研項目

·國家自然科學基金，基于頻率相關模型的時間交替ADC頻率響應失配誤差的自適應校正方法研究
·北京市自然科學基金基于壓縮感知（CS）的模擬信息轉換（AIC）的關鍵技術研究
·國家教育部博士點基金，時間交替模數(shù)轉換器（TIADC）的全數(shù)字校準技術研究
·北京市自然科學基金，基于信號重組的時間交替高速ADC的校準技術研究
·北京市教委項目，時間交替模數(shù)轉換器的自適應校準方法研究
·北京工業(yè)大學青年科研基金，時間交替模數(shù)轉換器時間誤差的數(shù)字校準技術研究
·北京海爾集成電路設計有限公司，模擬-數(shù)字轉換器的數(shù)字后處理技術的研究
·北京海爾集成電路設計有限公司，高速并行模數(shù)轉換器設計的關鍵技術研究
·北京海爾集成電路設計有限公司，多通道模數(shù)轉換器通道失配誤差校正技術研究

四、教學工作

·主講研究生《集成電路設計與Verilog語言》課程。
·主講本科生《ASIC設計及應用》課程。

五、論文發(fā)表

·近年來在IEEE Transactions、CSSP等國際期刊發(fā)表論文40余篇。
·申請國家發(fā)明專利10余項。

六、聯(lián)系方式

E-mail: liusujuan@bjut.edu.cn

Tel：010-67391269

地址：北京市朝陽區(qū)平樂園100號北京工業(yè)大學電子信息與控制工程學院

郵編：100124