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圖書簡介

     本書從EDA技術(shù)的應(yīng)用角度出發(fā)，簡明而系統(tǒng)地介紹了EDA技術(shù)的相關(guān)內(nèi)容。包括EDA技術(shù)的概念及特點，EDA技術(shù)的物質(zhì)載體——可編程邏輯器件，EDA技術(shù)的設(shè)計語言——硬件描述語言VHDL，EDA技術(shù)的開發(fā)設(shè)計流程和工具軟件MAX+plusⅡ及QuartusⅡ。此外，第5章給出了大量常用VHDL設(shè)計實例，第8章詳細闡述了幾個典型的EDA技術(shù)綜合應(yīng)用設(shè)計實例，并在第9 章編寫了多個實驗項目。 全書在取材和編排上，力求理論聯(lián)系實際，由淺入深，循序漸進。每章后面附有小結(jié)和習題，便于讀者學習和教學使用。 本書可作為高職高專電子信息、通信、自動化、計算機等相關(guān)專業(yè)的教材及社會相關(guān)技術(shù)的培訓教材，也可作為相關(guān)學科工程技術(shù)人員的參考書，還可作為電子產(chǎn)品制作、科技創(chuàng)新實踐、EDA課程設(shè)計和畢業(yè)設(shè)計等實踐活動的參考書。

目錄

第1章  概述
  1.1  EDA技術(shù)及其重要性
    1.1.1  EDA技術(shù)的實例引入
    1.1.2  EDA技術(shù)的概念
    1.1.3  EDA技術(shù)的重要性
  1.2  EDA技術(shù)的知識體系
    1.2.1  可編程邏輯器件
    1.2.2  硬件描述語言
    1.2.3  EDA丁具軟件
  1.3  EDA技術(shù)的特點和發(fā)展趨勢
    1.3.1  EDA技術(shù)的主要特點
    1.3.2  EDA技術(shù)的發(fā)展趨勢
  1.4  專用集成電路
    1.4.1  ASIC的概念和分類
    1.4.2  可編程ASIC技術(shù)展望
  本章小結(jié)
  思考題與習題
第2章  可編程邏輯器件
  2.1  概述
    2.1.1  可編程邏輯器件的發(fā)展歷程
    2.1.2  可編程邏輯器件的分類
    2.1.3  PLD的基本結(jié)構(gòu)
    2.1.4  PLD邏輯符號的畫法和約定
  2.2  簡單PLD
    2.2.1  PAL
    2.2.2  GAL
  2.3  CPLD和FPGA
    2.3.1  CPLD的基本結(jié)構(gòu)
    2.3.2  FPGA的基本結(jié)構(gòu)
    2.3.3  Altera公司器件介紹
  2.4  在系統(tǒng)可編程邏輯器件
    2.4.1  在系統(tǒng)可編程技術(shù)的特點
    2.4.2  ispLSl的結(jié)構(gòu)及系列器件介紹
    2.4.3  ispGDS介紹
  2.5  FPGA和CPLD的應(yīng)用選擇
    2.5.1  FPGA和CPLD的性能比較
    2.5.2  FPGA和CPLD的選用依據(jù)
  本章小結(jié)
  思考題與習題
第3章  EDA工具軟件與設(shè)計入門
  3.1  EDA設(shè)計流程
    3.1.1  設(shè)計輸入
    3.1.2  設(shè)計實現(xiàn)
    3.1.3  設(shè)計仿真
    3.1.4  編程或配置
  3.2  CPLD和FPGA的編程與配置方法
    3.2.1  CPLD的ISP方式編程
    3.2.2  使用PC并行口配置FPGA
    3.2.3  用專用配置器件配置FPGA
    3.2.4  使用單片機配置FPGA
  3.3  常用EDA工具軟件
    3.3.1  MAX+plusⅡ概述
    3.3.2  Lattice公司設(shè)計軟件概述
  3.4  MAX+plusⅡ的原理圖輸入設(shè)計示例
    3.4.1  一位全加器的設(shè)計
    3.4.2  2位十進制計數(shù)譯碼電路的設(shè)計
    3.4.3  總結(jié)與補充說明
  本章小結(jié)
  思考題與習題
第4章  VHDL硬件描述語言
  4.1  VHDL概述
    4.1.1  VHDL的優(yōu)點
    4.1.2  VHDL與Verilog、ABEL語言的比較
    4.1.3  學習VHDL的注意事項
  4.2  VHDL程序結(jié)構(gòu)
    4.2.1  簡單VHDL程序舉例
    4.2.2  實體
    4.2.3  結(jié)構(gòu)體
    4.2.4  庫
    4.2.5  程序包
    4.2.6  配置
  4.3  VHDL語言要素
    4.3.1  文字規(guī)則
    4.3.2  數(shù)據(jù)對象
    4.3.3  數(shù)據(jù)類型
    4.3.4  類型轉(zhuǎn)換
    4.3.5  操作符
  4.4  VHDL順序語句
    4.4.1  IF語句
    4.4.2  CASE語句
    4.4.3  LOOP語句
    4.4.4  NEXT語句
    4.4.5  EXIT語句
    4.4.6  wAIT語句
    4.4.7  RETURN語句
    4.4.8  NULL語句
  4.5  VHDL并行語句
    4.5.1  進程語句
    4.5.2  并行信號賦值語句
    4.5.3  塊語句
    4.5.4  元件例化語句
    4.5.5  生成語句
 *4.6  子程序及子程序調(diào)用語句
    4.6.1  子程序的定義
    4.6.2  子程序的調(diào)用
    4.6.3  子程序的重載
 *4.7  其他語句
    4.7.1  斷言語句
    4.7.2  報告語句
    4.7.3  屬性語句
    本章小結(jié)
    思考題與習題
第5章  常用VHDL設(shè)計實例
  5.1  組合邏輯電路設(shè)計
    5.1.1  門電路的設(shè)計
    5.1.2  常用組合電路的設(shè)計
  5.2  時序邏輯電路設(shè)計
    5.2.1  觸發(fā)器設(shè)計
    5.2.2  移位寄存器設(shè)計
    5.2.3  計數(shù)器設(shè)計
  5.3  狀態(tài)機設(shè)計
    5.3.1  摩爾型狀態(tài)機的設(shè)計
    5.3.2  米里型狀態(tài)機的設(shè)計
  5.4  存儲器設(shè)計
    5.4.1  只讀存儲器
    5.4.2  靜態(tài)隨機存儲器
    5.4.3  先人后出堆棧
  5.5  特色實用電路設(shè)計
    5.5.1  計數(shù)器型防抖動電路設(shè)計
    5.5.2  積分分頻器電路設(shè)計
  本章小結(jié)
  思考題與習題
第6章  MAX+plusⅡ使用進階
  6.1  MAX+plusⅡ的VHDL設(shè)計向?qū)?    6.1.1  創(chuàng)建源程序cnt4.vhd
    6.1.2  創(chuàng)建源程序dec17s.vhd
    6.1.3  完成頂層文件設(shè)計
    6.1.4  頂層工程文件的處理
    6.1.5  設(shè)計項目的其他信息和資源配置
  6.2  LPM的調(diào)用方法
    6.2.1  LPM的原理圖調(diào)用方法
    6.2.2  LPM的VHDL文本方式調(diào)用
  6.3  波形輸入設(shè)計方法
  6.4  用MAX+plusⅡ優(yōu)化設(shè)計
    6.4.1  全局邏輯綜合選項
    6.4.2  局部邏輯綜合選項
    6.4.3  探針的使用
    6.4.4  打包
  6.5  其他設(shè)置
    6.5.1  編程文件轉(zhuǎn)換
    6.5.2  MAX+plusⅡ的安裝
  本章小結(jié)
  思考題與習題
第7章  QuartusⅡ軟件及應(yīng)用
  7.1  QuartusⅡ軟件的圖形用戶界面
    7.1.1  工程導航區(qū)
    7.1.2  狀態(tài)區(qū)
    7.1.3  信息區(qū)
    7.1.4  丁作區(qū)
    7.1.5  快捷命令丁具欄
  7.2  QuartusⅡ軟件的圖形編輯輸入法
    7.2.1  創(chuàng)建工程設(shè)計項目
    7.2.2  編輯設(shè)計原理圖
    7.2.3  設(shè)計編譯
    7.2.4  設(shè)計仿真
    7.2.5  引腳鎖定與編程下載
  7.3  QuartusⅡ軟件的文本編輯輸入法
    7.3.1  編輯設(shè)計文件
    7.3.2  創(chuàng)建工程
    7.3.3  編譯
    7.3.4  仿真
    7.3.5  引腳鎖定與下載
  7.4  層次電路設(shè)計
    7.4.1  頂層文件設(shè)計
    7.4.2  創(chuàng)建各模塊的下層設(shè)計文件
    7.4.3  設(shè)計項目的編譯仿真
    7.4.4  層次顯示
  本章小結(jié)
  思考題與習題
第8章  EDA技術(shù)綜合應(yīng)用設(shè)計實例
  8.1  數(shù)字鐘
    8.1.1  數(shù)字鐘的設(shè)計要求
    8.1.2  數(shù)字鐘的頂層結(jié)構(gòu)
    8.1.3  數(shù)字鐘各模塊的VHDL源程序設(shè)計
  8.2  智力競賽搶答器
    8.2.1  搶答器的功能描述
    8.2.2  搶答器的設(shè)計
  8.3  交通燈控制器
    8.3.1  交通燈控制器功能要求
    8.3.2  交通燈控制器的設(shè)計
    8.3.3  仿真波形
    8.3.4  下載驗證
  8.4  8路彩燈控制器
    8.4.1  8路彩燈控制器的功能要求
    8.4.2  8路彩燈控制器的設(shè)計
    8.4.3  下載驗證
  8.5  簡易數(shù)字頻率計
    8.5.1  設(shè)計任務(wù)
    8.5.2  數(shù)字頻率計的設(shè)計
  本章小結(jié)
  思考題與習題
第9章  EDA實驗開發(fā)系統(tǒng)與實驗
  9.1  Gw48系列實驗開發(fā)系統(tǒng)使用說明
    9.1.1  Gw48系統(tǒng)使用注意事項
    9.1.2  GW48系統(tǒng)主板結(jié)構(gòu)與使用方法
    9.1.3  實驗電路結(jié)構(gòu)圖
    9.1.4  GW48-CK/GK/PK系統(tǒng)結(jié)構(gòu)圖信號與芯片引腳對照表
  9.2  EDA實驗
    9.2.1  實驗1——用原理圖輸入法設(shè)計4位全加器
    9.2.2  實驗2——計數(shù)譯碼顯示電路設(shè)計
    9.2.3  實驗3——計數(shù)器的設(shè)計
    9.2.4  實驗4——簡易彩燈控制器
    9.2.5  實驗5——用原理圖輸入法設(shè)計4位十進制計數(shù)譯碼器
    9.2.6  實驗6——用原理圖輸入法設(shè)計2位十進制頻率計
    9.2.7  實驗7——序列檢測器設(shè)計
    9.2.8  實驗8——用LPM設(shè)計8位數(shù)控分頻器和4位乘法器
    9.2.9  實驗9——脈寬可調(diào)的方波信號發(fā)生器設(shè)計
    9.2.10  實驗10——“梁�！睒非�演奏電路
參考文獻

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