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圖書簡介

　　《FPGA/CPLD技術(shù)實(shí)用教程》從實(shí)際應(yīng)用角度出發(fā)，以Ahera公司的FPGA／CPLD芯片及相關(guān)EDA軟件為載體，由淺入深地介紹了基于FPGA／CPLD器件的應(yīng)用系統(tǒng)軟硬件沒計(jì)相關(guān)知識(shí)與工程技巧；QuartusII開發(fā)工具軟件的使用方法與開發(fā)技術(shù)；VHDL語言的語法結(jié)構(gòu)和編程技巧以及常用組合與時(shí)序邏輯電路的設(shè)計(jì)方法�！禙PGA/CPLD技術(shù)實(shí)用教程》同時(shí)以康芯GW48EDA實(shí)驗(yàn)開發(fā)系統(tǒng)為例，簡單介紹了應(yīng)用開發(fā)的步驟與技巧。
　　《FPGA/CPLD技術(shù)實(shí)用教程》結(jié)構(gòu)清晰、內(nèi)容全面并且重點(diǎn)突出，基礎(chǔ)知識(shí)與大量實(shí)例相結(jié)合，突出實(shí)用性和可操作性，略去了部分抽象冷僻的內(nèi)容，重點(diǎn)放在基本概念和常用方法的講解上。《FPGA/CPLD技術(shù)實(shí)用教程》可作為高職院校電子信息、機(jī)電、通信、自動(dòng)化、計(jì)算機(jī)等專業(yè)的教材或教學(xué)參考書使用，也可作為從事各類電子系統(tǒng)設(shè)計(jì)的廣大工程技術(shù)人員的培訓(xùn)教材或?qū)嵱霉ぞ邥��?
目錄
第1章　可編程邏輯器件簡介
　1.1　可編程邏輯設(shè)計(jì)技術(shù)簡介
　　1.1.1　可編程邏輯器件發(fā)展簡史
　　1.1.2　可編程邏輯器件特點(diǎn)
　　1.1.3　可編程邏輯器件分類
　　1.1.4　主要可編程邏輯器件生產(chǎn)廠商及典型器件
　1.2　FPGA／CPLD的基本結(jié)構(gòu)
　　1.2.1　CPLD的基本結(jié)構(gòu)
　　1.2.2　FPGA的基本結(jié)構(gòu)
　　1.2.3　CPLD和FPGA的比較及選用
　1.3　FPGA／CPLD的設(shè)計(jì)流程
　1.4　FPGA／CPLD的開發(fā)工具－EDA軟件
　　1.4.1　設(shè)計(jì)輸入工具
　　1.4.2　綜合工具
　　1.4.3　仿真工具
　　1.4.4　實(shí)現(xiàn)與優(yōu)化工具
　　1.4.5　后端輔助工具
　　1.4.6　驗(yàn)證調(diào)試工具
　　1.4.7　系統(tǒng)級(jí)設(shè)計(jì)環(huán)境
　1.5　下一代可編程邏輯設(shè)計(jì)技術(shù)展望
　　1.5.1　下一代可編程邏輯器件硬件發(fā)展趨勢
　　1.5.2　下一代EDA軟件設(shè)計(jì)方法發(fā)展趨勢
　1.6　Ahera典型FPGA／CPLD的結(jié)構(gòu)
　　1.6.1　Altera高密度FPGA
　　1.6.2　Altera低成本FPGA
　　1.6.3　Altera的CPLD器件
　1.7　本章小結(jié)
　1.8　習(xí)題
第2章　VHDL硬件描述語言
　2.1　VHDL概述
　　2.1.1　VHDL語言的特點(diǎn)
　　2.1.2　VHDL程序的一般結(jié)構(gòu)
　2.2　VHDL語言的程序結(jié)構(gòu)
　　2.2.1　實(shí)體（ENTTY）
　　2.2.2　結(jié)構(gòu)體（ARCHITECTURE）
　　2.2.3　庫（LIBRARY）
　　2.2.4　程序包（PACKAGE）
　　2.2.5　配置（CONFIGURATION）
　2.3　VHDL語言的數(shù)據(jù)類型
　　2.3.1　VHDL的文字規(guī)則
　　2.3.2　VHDL的數(shù)據(jù)對象（Data0bject）
　　2.3.3　VHDL的數(shù)據(jù)類型（Data　Type）
　　2.3.4　VHDL的類型轉(zhuǎn)換
　2.4　VHDL的操作符（Operator）
　　2.4.1　操作符的種類
　　2.4.2　操作符的優(yōu)先級(jí)
　　2.4.3　邏輯操作符（LogicalOperator。）
　　2.4.4　關(guān)系操作符（IlelationalOperatol）
　　2.4.5　算術(shù)操作符（AritIlmeticOperator）
　2.5　VHDL的順序語句（SequentialStatement）
　　2.5.1　賦值語句
　　2.5.2　流程控制語句
　　2.5.3　等待語句（WAIT）
　　2.5.4　子程序調(diào)用語句
　　2.5.5　返回語句（RETURN）
　　2.5.6　空操作語句（NULL）
　　2.5.7　其他順序語句
　2.6　VHDL的并行語句（ConcurTentStatement，）
　　2.6.1　塊語句（BlockStatement）
　　2.6.2　進(jìn)程語句（ProcessStatement）
　　2.6.3　并行過程調(diào)用語句（ConcurrentProcedure（Jail）
　　2.6.4　并行信號(hào)賦值語句（ConcurrentSignalAssignment）
　　2.6.5　元件例化語句（ComponentInstanfiat：ion）
　　2.6.6　生成語句（CenerateStatement）
　2.7　本章小結(jié)
　2.8　習(xí)題
第3章　QuartusⅡ軟件及應(yīng)用
　3.1　QuaitusⅡ軟件概述
　　3.1.1　QuailusⅡ軟件的功能簡介
　　3.1.2　QuariusⅡ軟件的用戶界面
　3.2　基本設(shè)計(jì)流程
　　3.2.1　工程文件管理
　　3.2.2　創(chuàng)建QuartusⅡ的工程
　　3.2.3　設(shè)計(jì)輸入方式
　　3.2.4　基于圖形編輯輸入法的設(shè)計(jì)過程
　　3.2.5　基于文本編輯輸入法的設(shè)計(jì)過程
　3.3　SignalProbe及SignalTapⅡ邏輯分析器
　　3.3.1　SignalProbe
　　3.3.2　SignalTapⅡ邏輯分析器
　3.4　本章小結(jié)
　3.5　習(xí)題
第4章　組合邏輯電路設(shè)計(jì)
第5章　時(shí)序邏輯電路設(shè)計(jì)
第6章　GW48　EDA實(shí)驗(yàn)系統(tǒng)使用方法簡介

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